SerDes接口——架构与电路

        随着通信技术的飞速发展，高速串行互连以其结构简单，不需要传输同步时钟，相比并行传输有更高数据传输效率的优点，成为现代通信和数据传输的重要组成部分。随着对数据传输速率要求的不断提高，SERDES应运而生。它是一种时分多路复用(TDM)、点对点的通信技术，即在发送端多路低速并行信号被转换成高速串行信号，经过传输媒体(光缆或铜线)，最后在接收端高速串行信号重新转换成低速并行信号。
        SERDES(Serializer and Deserializer)接口作为高速串行通信的重要组成部分，对其芯片的研究和设计一直是一个热点。SERDES接口由串行器(SER)和解串器(DES)两部分组成，串行器由并串转换电路、发射器组成，结构比较简单，而解串器由接收器、串并转换电路和时钟与数据恢复电路CDR(Clock and Data Recovery)组成，接VI中串行器的功能是将低速的并行信号转换成为高速低压差分信号LVDS(Low Voltage Differential Signaling)，然后串化并发送出去，而解串器的功能是

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